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複数クロックの同期:ハードウェア設定
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2017年 12月 19日
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02:31
このビデオはTIDA-01021 の 2 つのクロック出力間の DEV_CLK スキュー、2 個の ADC12DJ3200EVM のアナログ・チャネル間スキューを解説します。
システム性能の最適化と設計時間 超低クロック・ジェネレータ LMK03328
日付:
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2016年 1月 13日
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07:12
今日はTIの最新クロック・ジェネレータLMK03328の性能および機能に関するデモをお見せします。
TX Signal Chain Implementation for Wide Band and High Frequency Signal Generation
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2016年 11月 10日
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13:45
The system design for an arbitrary waveform generator (AWG) and its functional blocks, including a discussion of the AWG amplifier path and design methodology.
LMK03328 EVM Setup and Programming with TICS Pro GUI
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2017年 1月 13日
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08:50
EVM setup and programming using TICS Pro GUI with WEBENCH clock design report to configure and program the device. The video also covers frequency planning tec
LMK03328 Frequency Margining and EEPROM programming with TICS Pro GUI
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2017年 1月 13日
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04:41
LMK03328 frequency margining example for generating multiple frequency plan configurations (nominal, margin high, and margin low) and programming these to the E
Get Your Clocks in Sync: Hardware Setup
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2017年 8月 14日
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02:31
This video demonstrates DEV_CLK skew between two clock outputs of the clocking reference design and the analog channel to channel skew between 2 ADC12DJ3200EVMs
Get Your Clocks in Sync: Software Setup
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2017年 8月 7日
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04:20
This video demonstrates the software setup of the Multi-Channel JESD204B 15 GHz Clocking Reference Design for DSO, Radar and 5G Wireless Testers
Get Your Clocks in Sync for JESD204B Data Converters
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2017年 9月 6日
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19:17
This video will explore a reference design that shows how to synchronize multiple high-speed JESD204B data converters.
Synchronization of High Speed Multichannel JESD204B Compliant Clocks Part 1
日付:
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2018年 7月 17日
所要時間::
07:50
Learn about the high speed multi-channel clocking requirements and challenges.
How to synchronize high speed multi-channel clocks?
This training explains how to synchronize high speed multi-channel clocks used in high-speed end equipment with multi-channel transceiver system.
Synchronization of High Speed Multichannel JESD204B Compliant Clocks Part 2
日付:
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2018年 7月 25日
所要時間::
09:56
Learn about the JESD204B compliant high speed multichannel synchronized clocking architecture
Synchronization of High Speed Multichannel JESD204B Compliant Clocks Part 3
日付:
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2018年 7月 25日
所要時間::
11:22
Learn about the high channel count clocking solution.
TI's Bulk Acoustic Wave Clocking Technology
日付:
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2019年 2月 25日
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03:02
This video details TI’s Bulk Acoustic Wave (BAW) clocking technology, optimized to improve network performance, reduce BOM and increase immunity to interference
Clocking solutions for high-speed multi-channel applications
Learn more about clocking solutions for high-speed multi-channel applications.
System design considerations
This video series will cover clocks and timing system design considerations such as clock tree design, frequency planning and noise reduction.
LMK04800 Clock Jitter Cleaner/Distribution Demo
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2014年 11月 2日
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05:23
Alan demonstrates the LMK04800 clock jitter cleaner and distribution family including: * Ultra-Low RMS Jitter Performance using low-cost external crystal
Clock Design Tool - Device Simulation
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2014年 11月 2日
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08:53
Dean shows clock device simulation using TI's easy-to-use Clock Design Tool.
Clock Design Tool - Getting Started
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2014年 11月 2日
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11:48
Dean introduces TI's Clock Design Tool and its easy-to-use graphical user interface
Clock Design Tool - Loop Filter Design
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2014年 11月 2日
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05:31
Dean shows how to use TI's Clock Design Tool to quickly do PLL loop filter design. TI Clock Design Tool software is used to aid part selection, loop filter des
Utilizing JESD204B interface in low cost applications
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2014年 11月 8日
所要時間::
02:47
Get an overview of the 4-channel, 50-MSPS DEV-ADC34J22 evaluation module. The board features TI's ADC34J22 ADC, LMK04828 jitter cleaner and THS4541 fully diffe