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システム性能の最適化と設計時間 超低クロック・ジェネレータ LMK03328
日付:
所要時間：:
2016年 1月 13日
所要時間：:
07:12
今日はTIの最新クロック・ジェネレータLMK03328の性能および機能に関するデモをお見せします。
複数クロックの同期：ハードウェア設定
日付:
所要時間：:
2017年 12月 19日
所要時間：:
02:31
このビデオはTIDA-01021 の 2 つのクロック出力間の DEV_CLK スキュー、2 個の ADC12DJ3200EVM のアナログ・チャネル間スキューを解説します。
Better Clocking for Serial Link Applications: TI's BAW-Based LMK05318
日付:
所要時間：:
2018年 12月 11日
所要時間：:
04:27
This video provides an overview of TI's BAW-based network synchronizer clock device and its benefits in clocking 400G serial link applications.
Clock Design Tool - Device Simulation
日付:
所要時間：:
2014年 11月 2日
所要時間：:
08:53
Dean shows clock device simulation using TI's easy-to-use Clock Design Tool.
Clock Design Tool - Getting Started
日付:
所要時間：:
2014年 11月 2日
所要時間：:
11:48
Dean introduces TI's Clock Design Tool and its easy-to-use graphical user interface
Clock Design Tool - Loop Filter Design
日付:
所要時間：:
2014年 11月 2日
所要時間：:
05:31
Dean shows how to use TI's Clock Design Tool to quickly do PLL loop filter design. TI Clock Design Tool software is used to aid part selection, loop filter des
Clocking solutions for high-speed multi-channel applications
Learn more about clocking solutions for high-speed multi-channel applications.
Frequency planning and loop filter design using CDCE62005
日付:
所要時間：:
2014年 11月 1日
所要時間：:
04:14
Planning and loop filter design is now easy using the latest tools available in the CDCE62005 GUI.
Get Your Clocks in Sync for JESD204B Data Converters
日付:
所要時間：:
2017年 9月 6日
所要時間：:
19:17
This video will explore a reference design that shows how to synchronize multiple high-speed JESD204B data converters.
Get Your Clocks in Sync: Hardware Setup
日付:
所要時間：:
2017年 8月 14日
所要時間：:
02:31
This video demonstrates DEV_CLK skew between two clock outputs of the clocking reference design and the analog channel to channel skew between 2 ADC12DJ3200EVMs
Get Your Clocks in Sync: Software Setup
日付:
所要時間：:
2017年 8月 7日
所要時間：:
04:20
This video demonstrates the software setup of the Multi-Channel JESD204B 15 GHz Clocking Reference Design for DSO, Radar and 5G Wireless Testers
Hitless Switching with DPLL Network Clock Synchronizers from TI
日付:
所要時間：:
2018年 3月 27日
所要時間：:
01:18
Hitless Switching: Watch how our innovative phase cancellation eliminates phase hits in clock applications.
How to synchronize high speed multi-channel clocks?
This training explains how to synchronize high speed multi-channel clocks used in high-speed end equipment with multi-channel transceiver system.
Introduction to TI’s rad hard Space Products
日付:
所要時間：:
2016年 6月 28日
所要時間：:
03:30
Get to know the industry’s largest portfolio of rad hard products and design resources for space flight.
LMK03328 EVM Setup and Programming with TICS Pro GUI
日付:
所要時間：:
2017年 1月 13日
所要時間：:
08:50
EVM setup and programming using TICS Pro GUI with WEBENCH clock design report to configure and program the device. The video also covers frequency planning tec
LMK03328 Frequency Margining and EEPROM programming with TICS Pro GUI
日付:
所要時間：:
2017年 1月 13日
所要時間：:
04:41
LMK03328 frequency margining example for generating multiple frequency plan configurations (nominal, margin high, and margin low) and programming these to the E
LMK04800 Clock Jitter Cleaner/Distribution Demo
日付:
所要時間：:
2014年 11月 2日
所要時間：:
05:23
Alan demonstrates the LMK04800 clock jitter cleaner and distribution family including: * Ultra-Low RMS Jitter Performance using low-cost external crystal
LMK04826/8: JESD204B-compliant clock jitter cleaners
日付:
所要時間：:
2014年 11月 8日
所要時間：:
10:39
Timothy demonstrates how to use the LMK0482x devices in JESD204B applications and illustrates the benefits of designing with the JESD204B interface.
Optimize System Performance and Design Time with the LMK03328 Ultra-Low-Jitter Clock Generator
日付:
所要時間：:
2015年 9月 28日
所要時間：:
07:12
Deepa shows us how easy it is to implement the LMK03328 features in your system design.