ヒント:複数の語句はコンマで区切ってください

入力例:11/29/2021

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76 結果
 The TIDA-01021 connected to the ADC12DJ3200EVM and LMX2594EVM.

複数クロックの同期:ハードウェア設定

日付:
2017年 12月 19日

所要時間::
02:31
このビデオはTIDA-01021 の 2 つのクロック出力間の DEV_CLK スキュー、2 個の ADC12DJ3200EVM のアナログ・チャネル間スキューを解説します。

低消費電流で高性能のTI製シンセサイザでワイヤレス設計の向上 LMX2571

日付:
2015年 12月 7日

所要時間::
07:38
本日はLMX2571周波数シンセサイザについて説明します

TI の LMX2592 高性能RFシンセサイザ

日付:
2016年 4月 7日

所要時間::
04:56
今日はLMX2592について説明します。

ENGINEER IT (エンジニア IT) 優れたノイズ特性の PLL & VCO を設計する方法

日付:
2016年 4月 22日

所要時間::
18:17
このビデオでは フェーズ・ロック・ループ・アプリケーションのループ帯域幅について説明します。

LMH2832 デジタル可変ゲイン・アンプの概要

日付:
2016年 12月 14日

所要時間::
03:50
このビデオでは、TI の LMH2832 をご紹介します。この製品は 1.1GHz で動作するデュアル・チャネルの完全差動デジタル可変ゲイン・アンプです。
Fully Differential Amplifiers - Input and output, common-mode and differential-swing analysis

TI Precision Labs – Fully Differential Amplifiers – Input, output, common-mode & differential-swing

日付:
2017年 7月 10日

所要時間::
14:13
This video discusses how to estimate an FDAs common-mode and differential swing at the inputs and the outputs and its dependence on the amplifier configuration
Fully Differential Amplifiers - FDA stability and simulating phase margin

TI Precision Labs – Fully Differential Amplifiers – FDA Stability and Simulating Phase Margin

日付:
2017年 7月 10日

所要時間::
17:38
This video discusses FDA stability and open-loop gain. You will also learn how to calculate and simulate with TINA-TI for FDAs.
Fully Differential Amplifiers - Noise analysis, advanced compensation technique and variable gain FDAs

TI Precision Labs – Fully Differential Amplifiers – Noise, compensation techniques and variable gain

日付:
2017年 7月 10日

所要時間::
15:55
This video discusses the various noise sources of an FDA and the effects of using large resistors in the feedback network of high-speed FDAs.

Get Your Clocks in Sync: Hardware Setup

日付:
2017年 8月 14日

所要時間::
02:31
This video demonstrates DEV_CLK skew between two clock outputs of the clocking reference design and the analog channel to channel skew between 2 ADC12DJ3200EVMs

Get Your Clocks in Sync for JESD204B Data Converters

日付:
2017年 9月 6日

所要時間::
19:17
This video will explore a reference design that shows how to synchronize multiple high-speed JESD204B data converters.
Optimize Your RF Sampling ADC Receiver Performance with the Frequency & Sample Rate Planning Calculator

Optimize RF sampling ADC receiver performance with the frequency & sample rate planning calculator

日付:
2018年 4月 6日

所要時間::
34:18
This video will go over what ADC SFDR's are, explain the concept of frequency planning and provide tools to help with RF sampling design. 

Webinar - What you need to know about Clock Generators, Buffers and RF Synthesizers

日付:
2018年 6月 27日

所要時間::
54:17
Want to learn more about Clock Generators and Buffers ? You're in the right place!

Synchronization of High Speed Multichannel JESD204B Compliant Clocks Part 1

日付:
2018年 7月 17日

所要時間::
07:50
Learn about the high speed multi-channel clocking requirements and challenges.

How to synchronize high speed multi-channel clocks?

This training explains how to synchronize high speed multi-channel clocks used in high-speed end equipment with multi-channel transceiver system.

Synchronization of High Speed Multichannel JESD204B Compliant Clocks Part 2

日付:
2018年 7月 25日

所要時間::
09:56
Learn about the JESD204B compliant high speed multichannel synchronized clocking architecture

Synchronization of High Speed Multichannel JESD204B Compliant Clocks Part 3

日付:
2018年 7月 25日

所要時間::
11:22
Learn about the high channel count clocking solution.

Getting started with the AFE74xx RF-sampling transceiver

Quickly evaluate the AFE7444 and/or AFE7422 RF-sampling transceiver with this series of how to videos.

Selecting the right configuration mode with the AFE74xx EVM

日付:
2019年 3月 1日

所要時間::
03:27
Learn how to select the desired mode to configure the AFE.

Hardware setup for internal PLL operation with the AFE74xx EVM

日付:
2019年 3月 1日

所要時間::
02:42
Learn how to set up the hardware for internal PLL clock operation.

How to configure the AFE74xx DAC in Mode 4 using the internal PLL

日付:
2019年 3月 1日

所要時間::
04:55
Learn how to configure the DAC in mode 4 with the AFE74xx EVM
76 結果
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