ヒント:複数の語句はコンマで区切ってください

入力例:10/01/2020

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80 結果
 The TIDA-01021 connected to the ADC12DJ3200EVM and LMX2594EVM.

複数クロックの同期:ハードウェア設定

日付:
2017年 12月 19日

所要時間::
02:31
このビデオはTIDA-01021 の 2 つのクロック出力間の DEV_CLK スキュー、2 個の ADC12DJ3200EVM のアナログ・チャネル間スキューを解説します。

LMH2832 デジタル可変ゲイン・アンプの概要

日付:
2016年 12月 14日

所要時間::
03:50
このビデオでは、TI の LMH2832 をご紹介します。この製品は 1.1GHz で動作するデュアル・チャネルの完全差動デジタル可変ゲイン・アンプです。

ENGINEER IT (エンジニア IT) 優れたノイズ特性の PLL & VCO を設計する方法

日付:
2016年 4月 22日

所要時間::
18:17
このビデオでは フェーズ・ロック・ループ・アプリケーションのループ帯域幅について説明します。

TI の LMX2592 高性能RFシンセサイザ

日付:
2016年 4月 7日

所要時間::
04:57
今日はLMX2592について説明します。

低消費電流で高性能のTI製シンセサイザでワイヤレス設計の向上 LMX2571

日付:
2015年 12月 7日

所要時間::
07:38
本日はLMX2571周波数シンセサイザについて説明します

Code Composer Studio v6

日付:
2014年 11月 8日

所要時間::
03:00
TIの幅広い組込みプロセッサ向けの統合開発環境 Code Composer Studio v6をご紹介します
Capture a tone with the AFE77xx RX

Capture tone with the AFE77xx RX

日付:
2020年 1月 24日

所要時間::
01:41
This video tutorial covers how to capture tone with the AFE77xx RX.

Getting started with the AFE7700

Topics including EVM set up, correcting mismatch and leakage, and sending a pattern file.
Correcting mismatch and leakage with the AFE77xx

Correcting mismatch and leakage with the AFE77xx

日付:
2020年 1月 24日

所要時間::
03:14
This video tutorial covers how to correct mismatch and leakage with the AFE77xx.
Send a pattern file to the AFE77xx TX

Send a pattern file to the AFE77xx TX

日付:
2020年 1月 24日

所要時間::
01:55
This video tutorial covers how to send a pattern file to the AFE77xx TX.
Setting up the AFE77xx EVM

Set up the AFE77xx EVM

日付:
2020年 1月 24日

所要時間::
01:01
Learn how to set up the AFE77xx EVM with this quick tutorial video.
Sending a two-tone signal with the AFE77xx TX

Send a two-tone signal from the AFE77xx TX

日付:
2020年 1月 24日

所要時間::
03:55
This video  tutorial covers how to send a two-tone signal from the AFE77xx TX.
Getting started with the AFE77xx EVM

Getting started with the AFE77xx EVM

日付:
2020年 1月 24日

所要時間::
01:25
Get started with the AFE77xx EVM faster with this easy-to-use tutorial.

TI Precision Labs - Clocks and Timing: System Design Considerations

The videos in this series will discuss distributed vs. centralized clock tree, synchronous vs. free-running designs and other selection criteria requirements to help narrow down a clock tree solution. We will discuss other design considerations including frequency planning, spurious and EMI noise reduction techniques, system clock optimization/tuning and clocking for JESD204 B/C systems.

Reduce design risk for Low Earth Orbit satellites and other New Space applications

日時: 2019年 10月 8日 14:00
What is NewSpace? What does it mean for satellite design? Explore products that meet quality & reliability requirements for short space flights and LEO designs.
Precision Top

TI Precision Labs

TI Precision Labs (TIPL) is the most comprehensive online classroom for analog signal chain designers. From foundational knowledge to advanced concepts, our logical, sequenced and comprehensive teaching approach is both intuitive and practical. The training series, which includes videos and downloadable reference materials, will deepen the technical expertise of experienced engineers and accelerate the development of those early in their career.

JESD204B Video Blog Series

The JESD204B video blog series explores the basic concepts related to the JESD204B SerDes standard in relation to High Speed Data Converter products.

RF Sampling Series

This series explores the new realm of RF sampling converters for use in high frequency, large bandwidth systems.

Advanced JESD204B Topics

This series explores advanced topics related to the JESD204B SerDes standard associated with extending the link length and multi-device synchronization.

General High-Speed Trainings

This series covers general updates on Texas Instruments' high-speed signal chain portfolio.

80 結果
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