힌트: 여러 단어는 쉼표로 구분

예: 06/20/2022

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힌트: 여러 단어는 쉼표로 구분

예: 06/20/2022

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27 결과

TI의 저전류 고성능 신시사이저 LMX2571로 무선 설계 업그레이드하기

날짜:
2017년 8월 3일

기간::
07:38
고성능 신시사이저 LMX2571에 대한 교육 비디오입니다. (한글자막 포함)

신시사이저 위상 잡음 분석하는 방법

날짜:
2017년 8월 18일

기간::
08:37
비디오를 시청하시고 애플리케이션에서 간편하게 신시사이저 위상 잡음을 분석하는 방법에 대해 배워보세요.
우수한 PLL 및VCO 잡음 성능을 설계하는 방법

우수한 PLL 및VCO 잡음 성능을 설계하는 방법

날짜:
2017년 12월 11일

기간::
18:17
엔지니어 잇: 우수한 PLL 및VCO 잡음 성능을 설계하는 방법
TI의 고성능 RF 신서사이저

TI의 고성능 RF 신서사이저 LMX2592

날짜:
2017년 12월 12일

기간::
04:56
엔지니어 잇: TI의 고성능 RF 신서사이저LMX2592
신시사이저 위상 잡음 분석하는 방법

신시사이저 위상 잡음 분석하는 방법

날짜:
2017년 12월 19일

기간::
08:37
신시사이저 위상 잡음 분석하는 방법

Local oscillator and GHz clocks requirements in radio applications systems with LMX2594

This training series discusses the key requirements of local oscillators in microwave/RF and GHz clocks in radio applications.
Advanced Phase Synchronization Capabilities with Multiple RF PLLs using TI's LMX2594

Advanced Phase Synchronization Capabiliites with Multiple RF PLLs using TI's LMX2594

날짜:
2017년 4월 19일

기간::
07:08
Watch Nadeem demonstrate advanced phase synchronization capabilities with multiple RF PLLs using TI's high performance LMX2594.

Get Your Clocks in Sync: Hardware Setup

날짜:
2017년 8월 14일

기간::
02:31
This video demonstrates DEV_CLK skew between two clock outputs of the clocking reference design and the analog channel to channel skew between 2 ADC12DJ3200EVMs

Get Your Clocks in Sync: Software Setup

날짜:
2017년 8월 7일

기간::
04:20
This video demonstrates the software setup of the Multi-Channel JESD204B 15 GHz Clocking Reference Design for DSO, Radar and 5G Wireless Testers

Get Your Clocks in Sync for JESD204B Data Converters

날짜:
2017년 9월 6일

기간::
19:17
This video will explore a reference design that shows how to synchronize multiple high-speed JESD204B data converters.

Webinar - What you need to know about Clock Generators, Buffers and RF Synthesizers

날짜:
2018년 6월 27일

기간::
54:17
Want to learn more about Clock Generators and Buffers ? You're in the right place!

Synchronization of High Speed Multichannel JESD204B Compliant Clocks Part 1

날짜:
2018년 7월 17일

기간::
07:50
Learn about the high speed multi-channel clocking requirements and challenges.

How to synchronize high speed multi-channel clocks?

This training explains how to synchronize high speed multi-channel clocks used in high-speed end equipment with multi-channel transceiver system.

Synchronization of High Speed Multichannel JESD204B Compliant Clocks Part 2

날짜:
2018년 7월 25일

기간::
09:56
Learn about the JESD204B compliant high speed multichannel synchronized clocking architecture

Synchronization of High Speed Multichannel JESD204B Compliant Clocks Part 3

날짜:
2018년 7월 25일

기간::
11:22
Learn about the high channel count clocking solution.

Clocking solutions for high-speed multi-channel applications

Learn more about clocking solutions for high-speed multi-channel applications.

System design considerations

This video series will cover clocks and timing system design considerations such as clock tree design, frequency planning and noise reduction.

Clock Design Tool - Device Simulation

날짜:
2014년 11월 2일

기간::
08:53
Dean shows clock device simulation using TI's easy-to-use Clock Design Tool.

Clock Design Tool - Getting Started

날짜:
2014년 11월 2일

기간::
11:48
Dean introduces TI's Clock Design Tool and its easy-to-use graphical user interface

Clock Design Tool - Loop Filter Design

날짜:
2014년 11월 2일

기간::
05:31
Dean shows how to use TI's Clock Design Tool to quickly do PLL loop filter design. TI Clock Design Tool software is used to aid part selection, loop filter des
27 결과
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