注意:各項之間請以逗號分隔

例如 , 12/02/2021

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496 結果

ADS7042 Performance Demonstration Kit

日期:
2015年 4月 17日

時間長度:
04:53
Learn how to set up and use the ADS7042 PDK and GUI. The ADS7042 is an ultra-low power and ultra-small size 12-bit, 1 MSPS SAR analog to digital converter. The

Processor Innovation in High Speed Data Acquisition Markets

日期:
2015年 4月 20日

時間長度:
01:04
TI brings its system optimized solution with pre-integrated ADCs & DACs to market.

Design 1°-accurate dials with TI’s inductive sensing technology

日期:
2015年 4月 24日

時間長度:
02:30
Tarig demonstrates how easy it is to make a dial using inductive sensing technology.

Why Use a JESD204B Device?

日期:
2015年 6月 11日

時間長度:
03:26
This video introduces the advantages that the JESD204B standard provides in high speed data converters

Synchronizing Multiple JESD204B ADCs

日期:
2015年 6月 11日

時間長度:
03:04
This video illustrates synchronizing two ADC12J4000 ADCs employing JESD204B interface

Extending JESD204B Link on Low Cost Substrates

日期:
2015年 6月 29日

時間長度:
03:34
This video discusses the JESD204B SERDES standard related to minimum integrity to maintain proper eye diagram. 

Introduction to the RF Sampling Architecture

日期:
2015年 6月 29日

時間長度:
03:21
Introduction to the RF sampling architecture in contrast to traditional direct conversion architectures typically used in existing transceivers.

Why RF Sampling

日期:
2015年 6月 29日

時間長度:
03:15
This video specifically addresses the benefits and advantages RF sampling provides that was limited or not possible with existing technology.

RF Sampling: Managing Data Rates

日期:
2015年 6月 29日

時間長度:
03:40
RF Sampling requires fast sampling rates, but the input data rates usually cannot keep pace.  The techniques to mitigate those limitations are addressed.

SAR and Delta-Sigma ADC Fundamentals

日期:
2015年 7月 9日

時間長度:
02:35
A comparison between two of the most common precision analog-to-digital converter (ADC) architectures: successive approximation register and delta-sigma

Selecting a JESD204B Subclass

日期:
2015年 7月 15日

時間長度:
05:14
This video discusses the three subclass modes in the JESD204B standard.  The pros and cons of operating in each subclass is discussed.

Talk like a Pro - Data Flow

日期:
2015年 7月 15日

時間長度:
03:54
This video illustrates the block diagram of the JESD204B SERDES transceiver.  The function of the individual blocks is described.

High-speed signal chain training series

Your portal to relevant training material on high-speed data converters and high-speed amplifiers.

Understanding Clock Jitter Impact to ADC SNR

日期:
2015年 7月 21日

時間長度:
02:57
This video discusses the sampling clock phase noise performance and how its performance over frequency offset impacts the GSPS ADC SNR performance.

TI 工業技術應用專題

本次系列主題推出工業應用與技術線上培訓,工業應用技術是德州儀器 (TI)

JESD204B Physical Layer

日期:
2015年 8月 6日

時間長度:
06:39
This video describes the JESD204B physical layer and the impact on channel integrity.  Mitigation techniques utilizing pre-emphasis and de-emphasis are illustra

JESD204B: Transport Layer

日期:
2015年 8月 6日

時間長度:
04:12
This video addresses the transport layer of JESD204B standard specifically breaking down how the data converters digital data is mapped into the SerDes frames.

ADS8353 ADC 性能演示套件

日期:
2015年 8月 18日

時間長度:
05:41
TI 精密模拟产品营销团队的 Anthony Vaughan 将向大家演示如何设置 TI 的 ADS8353 性能演示套件。ADS8353 是一种 16 位、双通道、同步采样的精密 ADC,每秒可同时采集 600 千赫样本。该 ADC 还具有两个内部电压基准,可单独支持每个通道。

IMS2015 - JOOS Demo

日期:
2015年 8月 28日

時間長度:
01:40
JESD204B is a common standard for implementing a SerDes interconnection between FPGA/Processor and the data converter. 

TI 工業技術應用專題(二)

TI 線上培訓視頻系列
496 結果
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